Rocket - tilelink - SRAM

匿名 (未验证) 提交于 2019-12-02 23:57:01

https://mp.weixin.qq.com/s/-z9n6SHyAiK2OE7mOSvC2Q

2. TLRAM

3) diplomacy node

4) lazy module

a. d_raw_data

b. d_decoded

a. in.d.bits.data

fire() => d_ram_valid = 1 => in.d.bits.data := d_decoded_raw
b. in.d.bits.corrupt
L. d_pause

N. a_sublane

R. a.fire()

when (in.a.fire()) {
d_ram_valid := a_ren
} otherwise {
d_ram_valid := Bool(false)
}

A. a.fire()

C. read

D. decode

E. d_pause

A. wen

B. write

4. sublane

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